pretraga knjiga
knjige
Donirati
Prijaviti se
Prijaviti se
prijavljenim korisnicima su dostupni:
lične preporuke
Telegram bot
istorija preuzimanja
poslati na Email ili Kindle
upravljanje zbirkama
sačuvanje u izabrano
Lično
Upite za knjige
Proučavanje
Z-Recommend
Spiskovi knjiga
Najpopularnije
Kategorije
Učešće
Donirati
Otpremanja
Litera Library
Donirati papirne knjige
Dodati papirne knjige
Search paper books
Moj LITERA Point
Pretraga ključnih reči
Main
Pretraga ključnih reči
search
1
Abstrakte Modellierung digitaler Schaltungen: VHDL vom funktionalen Modell bis zur Gatterebene
Springer-Verlag Berlin Heidelberg
Klaus ten Hagen (auth.)
modellierung
wert
abb
modell
daher
schaltungen
abstrakte
hagen
springer
klaus
heidelberg
digitaler
einheit
implementation
codefragment
modells
folgenden
anweisungen
anweisung
signal
urn
variablen
abschnitt
operationen
simulation
werte
zahl
modelle
gezeigt
schaltung
z.b
clk
reset
fsm
gatterebene
aile
signale
prozeb
datentypen
verwendet
beispiel
funktion
port
definiert
vhdl
diskutiert
posedge
instanz
vgl
modelliert
Godina:
1995
Jezik:
german
Fajl:
PDF, 18.81 MB
Vaši tagovi:
0
/
0
german, 1995
2
Entwurf von digitalen Schaltungen und Systemen mit HDLs und FPGAs: Einführung mit VHDL und SystemC
Oldenbourg Wissenschaftsverlag
Frank Kesel
,
Ruben Bartholomä
abbildung
vhdl
listing
beispiel
signal
schaltung
schaltungen
daher
abschnitt
funktion
verwendet
engl
fpgas
std_logic
flipflops
simulation
clk
beispielsweise
abb
ergibt
wert
zeile
bezeichnet
fpga
ausgang
ebene
port
siehe
handelt
synthese
verzögerungszeit
prozess
realisiert
systemc
anzahl
benötigt
downto
gezeigt
komponenten
architecture
digitalen
ergebnis
modellierung
daten
gate
gatter
timing
beschreibung
verdrahtung
wobei
Godina:
2013
Jezik:
german
Fajl:
PDF, 7.93 MB
Vaši tagovi:
0
/
0
german, 2013
3
Entwurf von digitalen Schaltungen und Systemen mit HDLs und FPGAs: Einführung mit VHDL und SystemC
Oldenbourg Wissenschaftsverlag
Frank Kesel
,
Ruben Bartholomä
für
abbildung
vhdl
können
listing
beispiel
signal
über
schaltung
schaltungen
daher
abschnitt
verwendet
funktion
engl
fpgas
std_logic
flipflops
clk
simulation
abb
beispielsweise
ergibt
wert
zeile
fpga
ausgang
bezeichnet
ebene
siehe
port
handelt
synthese
verzögerungszeit
prozess
realisiert
systemc
anzahl
benötigt
architecture
downto
gezeigt
komponenten
ergebnis
digitalen
daten
modellierung
gate
gatter
timing
Godina:
2009
Jezik:
german
Fajl:
PDF, 17.61 MB
Vaši tagovi:
0
/
0
german, 2009
4
Systematischer Entwurf digitaler Systeme: Von der System- bis zur Gatter-Ebene
Vieweg+Teubner Verlag
Prof. Dr. rer. nat. Franz J. Rammig (auth.)
abb
wert
beispiel
ebene
seqbegin
parbegin
dacapo
menge
falls
funktion
algorithmus
ap_buffer
anweisung
benutzt
angenommen
ansatz
beschreibung
transition
d.h
fehler
proceedings
operation
somit
wobei
implicit
simulation
werte
petri
erhält
folgende
gegeben
funktionen
beschrieben
operationen
daher
zeitpunkt
komponenten
req
abschnitt
genannt
derartige
mword
conbegin
prozedur
verschiedene
verschiedenen
ausgeführt
typ
seiten
array
Godina:
1989
Jezik:
german
Fajl:
PDF, 16.69 MB
Vaši tagovi:
0
/
0
german, 1989
1
Idite na
ovaj link
ili potražite bota „@BotFather“ u Telegramu
2
Pošaljite komandu /newbot
3
Navedite ime za svog bota
4
Navedite korisničko ime za bota
5
Kopirajte poslednju poruku od BotFather i ubacite je ovde
×
×